Nyaaori/rockbox
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rockbox/firmware/export/dm320.h

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28 KiB
C
Raw Blame History

/***************************************************************************
* __________ __ ___.
* Open \______ \ ____ ____ | | _\_ |__ _______ ___
* Source | _// _ \_/ ___\| |/ /| __ \ / _ \ \/ /
* Jukebox | | ( <_> ) \___| < | \_\ ( <_> > < <
* Firmware |____|_ /\____/ \___ >__|_ \|___ /\____/__/\_ \
* \/ \/ \/ \/ \/
* $Id$
*
* Copyright (C) 2007 by Karl Kurbjun
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****************************************************************************/
/** All register offset definitions for the TI DM320
* Taken from: http://svn.neurostechnology.com/filedetails.php?repname=neuros-bsp&path=%2Ftrunk%2Fkernels%2Flinux-2.6.15%2Finclude%2Fasm-arm%2Farch-ntosd-dm320%2Fio_registers.h&rev=0&sc=0
*/
#ifndef __DM320_H__
#define __DM320_H__
#define FRAME ((short *) (0x4470000))
#define PHY_IO_BASE 0x00030000
#define DM320_REG(addr) (*(volatile unsigned short *)(PHY_IO_BASE + (addr)))
/* Timer 0-3 */
#define IO_TIMER0_TMMD DM320_REG(0x0000)
#define IO_TIMER0_TMRSV0 DM320_REG(0x0002)
#define IO_TIMER0_TMPRSCL DM320_REG(0x0004)
#define IO_TIMER0_TMDIV DM320_REG(0x0006)
#define IO_TIMER0_TMTRG DM320_REG(0x0008)
#define IO_TIMER0_TMCNT DM320_REG(0x000A)
#define IO_TIMER1_TMMD DM320_REG(0x0080)
#define IO_TIMER1_TMRSV0 DM320_REG(0x0082)
#define IO_TIMER1_TMPRSCL DM320_REG(0x0084)
#define IO_TIMER1_TMDIV DM320_REG(0x0086)
#define IO_TIMER1_TMTRG DM320_REG(0x0088)
#define IO_TIMER1_TMCNT DM320_REG(0x008A)
#define IO_TIMER2_TMMD DM320_REG(0x0100)
#define IO_TIMER2_TMVDCLR DM320_REG(0x0102)
#define IO_TIMER2_TMPRSCL DM320_REG(0x0104)
#define IO_TIMER2_TMDIV DM320_REG(0x0106)
#define IO_TIMER2_TMTRG DM320_REG(0x0108)
#define IO_TIMER2_TMCNT DM320_REG(0x010A)
#define IO_TIMER3_TMMD DM320_REG(0x0180)
#define IO_TIMER3_TMVDCLR DM320_REG(0x0182)
#define IO_TIMER3_TMPRSCL DM320_REG(0x0184)
#define IO_TIMER3_TMDIV DM320_REG(0x0186)
#define IO_TIMER3_TMTRG DM320_REG(0x0188)
#define IO_TIMER3_TMCNT DM320_REG(0x018A)
/* Serial 0/1 */
#define IO_SERIAL0_TX_DATA DM320_REG(0x0200)
#define IO_SERIAL0_RX_DATA DM320_REG(0x0202)
#define IO_SERIAL0_TX_ENABLE DM320_REG(0x0204)
#define IO_SERIAL0_MODE DM320_REG(0x0206)
#define IO_SERIAL0_DMA_TRIGGER DM320_REG(0x0208)
#define IO_SERIAL0_DMA_MODE DM320_REG(0x020A)
#define IO_SERIAL0_DMA_SDRAM_LOW DM320_REG(0x020C)
#define IO_SERIAL0_DMA_SDRAM_HI DM320_REG(0x020E)
#define IO_SERIAL0_DMA_STATUS DM320_REG(0x0210)
#define IO_SERIAL1_TX_DATA DM320_REG(0x0280)
#define IO_SERIAL1_RX_DATA DM320_REG(0x0282)
#define IO_SERIAL1_TX_ENABLE DM320_REG(0x0284)
#define IO_SERIAL1_MODE DM320_REG(0x0286)
/* UART 0/1 */
#define IO_UART0_DTRR DM320_REG(0x0300)
#define IO_UART0_BRSR DM320_REG(0x0302)
#define IO_UART0_MSR DM320_REG(0x0304)
#define IO_UART0_RFCR DM320_REG(0x0306)
#define IO_UART0_TFCR DM320_REG(0x0308)
#define IO_UART0_LCR DM320_REG(0x030A)
#define IO_UART0_SR DM320_REG(0x030C)
#define IO_UART1_DTRR DM320_REG(0x0380)
#define IO_UART1_BRSR DM320_REG(0x0382)
#define IO_UART1_MSR DM320_REG(0x0384)
#define IO_UART1_RFCR DM320_REG(0x0386)
#define IO_UART1_TFCR DM320_REG(0x0388)
#define IO_UART1_LCR DM320_REG(0x038A)
#define IO_UART1_SR DM320_REG(0x038C)
/* Watchdog Timer */
#define IO_WATCHDOG_MODE 0x0400
#define IO_WATCHDOG_RESET 0x0402
#define IO_WATCHDOG_PRESCALAR 0x0404
#define IO_WATCHDOG_DIVISOR 0x0406
#define IO_WATCHDOG_EXT_RESET 0x0408
/* MMC/SD Controller */
#define IO_MMC_CONTROL 0x0480
#define IO_MMC_MEM_CLK_CONTROL 0x0482
#define IO_MMC_STATUS0 0x0484
#define IO_MMC_STATUS1 0x0486
#define IO_MMC_INT_ENABLE 0x0488
#define IO_MMC_RESPONSE_TIMEOUT 0x048A
#define IO_MMC_READ_TIMEOUT 0x048C
#define IO_MMC_BLOCK_LENGTH 0x048E
#define IO_MMC_NR_BLOCKS 0x0490
#define IO_MMC_NR_BLOCKS_COUNT 0x0492
#define IO_MMC_RX_DATA 0x0494
#define IO_MMC_TX_DATA 0x0496
#define IO_MMC_COMMAND 0x0498
#define IO_MMC_ARG_LOW 0x049A
#define IO_MMC_ARG_HI 0x049C
#define IO_MMC_RESPONSE0 0x049E
#define IO_MMC_RESPONSE1 0x04A0
#define IO_MMC_RESPONSE2 0x04A2
#define IO_MMC_RESPONSE3 0x04A4
#define IO_MMC_RESPONSE4 0x04A6
#define IO_MMC_RESPONSE5 0x04A8
#define IO_MMC_RESPONSE6 0x04AA
#define IO_MMC_RESPONSE7 0x04AC
#define IO_MMC_SPI_DATA 0x04AE
#define IO_MMC_SPI_ERR 0x04B0
#define IO_MMC_COMMAND_INDEX 0x04B2
#define IO_MMC_CLK_START_PHASE 0x04B4
#define IO_MMC_RESPONSE_TOUT_CNT 0x04B6
#define IO_MMC_READ_TOUT_CNT 0x04B8
#define IO_MMC_BLOCK_LENGTH_CNT 0x04BA
#define IO_MMC_SD_DMA_TRIGGER 0x04BC
#define IO_MMC_SD_DMA_MODE 0x04BE
#define IO_MMC_SD_DMA_ADDR_LOW 0x04C0
#define IO_MMC_SD_DMA_ADDR_HI 0x04C2
#define IO_MMC_SD_DMA_STATUS0 0x04C4
#define IO_MMC_SD_DMA_STATUS1 0x04C6
#define IO_MMC_SD_DMA_TIMEOUT 0x04C8
#define IO_SDIO_CONTROL 0x04CA
#define IO_SDIO_STATUS0 0x04CC
#define IO_SDIO_INT_ENABLE 0x04CE
#define IO_SDIO_INT_STATUS 0x04D0
/* Interrupt Controller */
#define IO_INTC_FIQ0 DM320_REG(0x0500)
#define IO_INTC_FIQ1 DM320_REG(0x0502)
#define IO_INTC_FIQ2 DM320_REG(0x0504)
#define IO_INTC_IRQ0 DM320_REG(0x0508)
#define IO_INTC_IRQ1 DM320_REG(0x050A)
#define IO_INTC_IRQ2 DM320_REG(0x050C)
#define IO_INTC_FIQENTRY0 DM320_REG(0x0510)
#define IO_INTC_FIQENTRY1 DM320_REG(0x0512)
#define IO_INTC_FIQ_LOCK_ADDR0 DM320_REG(0x0514)
#define IO_INTC_FIQ_LOCK_ADDR1 DM320_REG(0x0516)
#define IO_INTC_IRQENTRY0 DM320_REG(0x0518)
#define IO_INTC_IRQENTRY1 DM320_REG(0x051A)
#define IO_INTC_IRQ_LOCK_ADDR0 DM320_REG(0x051C)
#define IO_INTC_IRQ_LOCK_ADDR1 DM320_REG(0x051E)
#define IO_INTC_FISEL0 DM320_REG(0x0520)
#define IO_INTC_FISEL1 DM320_REG(0x0522)
#define IO_INTC_FISEL2 DM320_REG(0x0524)
#define IO_INTC_EINT0 DM320_REG(0x0528)
#define IO_INTC_EINT1 DM320_REG(0x052A)
#define IO_INTC_EINT2 DM320_REG(0x052C)
#define IO_INTC_RAW DM320_REG(0x0530)
#define IO_INTC_ENTRY_TBA0 DM320_REG(0x0538)
#define IO_INTC_ENTRY_TBA1 DM320_REG(0x053A)
#define IO_INTC_PRIORITY0 DM320_REG(0x0540)
#define IO_INTC_PRIORITY1 DM320_REG(0x0542)
#define IO_INTC_PRIORITY2 DM320_REG(0x0544)
#define IO_INTC_PRIORITY3 DM320_REG(0x0546)
#define IO_INTC_PRIORITY4 DM320_REG(0x0548)
#define IO_INTC_PRIORITY5 DM320_REG(0x054A)
#define IO_INTC_PRIORITY6 DM320_REG(0x054C)
#define IO_INTC_PRIORITY7 DM320_REG(0x054E)
#define IO_INTC_PRIORITY8 DM320_REG(0x0550)
#define IO_INTC_PRIORITY9 DM320_REG(0x0552)
#define IO_INTC_PRIORITY10 DM320_REG(0x0554)
#define IO_INTC_PRIORITY11 DM320_REG(0x0556)
#define IO_INTC_PRIORITY12 DM320_REG(0x0558)
#define IO_INTC_PRIORITY13 DM320_REG(0x055A)
#define IO_INTC_PRIORITY14 DM320_REG(0x055C)
#define IO_INTC_PRIORITY15 DM320_REG(0x055E)
#define IO_INTC_PRIORITY16 DM320_REG(0x0560)
#define IO_INTC_PRIORITY17 DM320_REG(0x0562)
#define IO_INTC_PRIORITY18 DM320_REG(0x0564)
#define IO_INTC_PRIORITY19 DM320_REG(0x0566)
#define IO_INTC_PRIORITY20 DM320_REG(0x0568)
#define IO_INTC_PRIORITY21 DM320_REG(0x056A)
#define IO_INTC_PRIORITY22 DM320_REG(0x056C)
/* GIO Controller */
#define IO_GIO_DIR0 DM320_REG(0x0580)
#define IO_GIO_DIR1 DM320_REG(0x0582)
#define IO_GIO_DIR2 DM320_REG(0x0584)
#define IO_GIO_INV0 DM320_REG(0x0586)
#define IO_GIO_INV1 DM320_REG(0x0588)
#define IO_GIO_INV2 DM320_REG(0x058A)
#define IO_GIO_BITSET0 DM320_REG(0x058C)
#define IO_GIO_BITSET1 DM320_REG(0x058E)
#define IO_GIO_BITSET2 DM320_REG(0x0590)
#define IO_GIO_BITCLR0 DM320_REG(0x0592)
#define IO_GIO_BITCLR1 DM320_REG(0x0594)
#define IO_GIO_BITCLR2 DM320_REG(0x0596)
#define IO_GIO_IRQPORT DM320_REG(0x0598)
#define IO_GIO_IRQEDGE DM320_REG(0x059A)
#define IO_GIO_CHAT0 DM320_REG(0x059C)
#define IO_GIO_CHAT1 DM320_REG(0x059E)
#define IO_GIO_CHAT2 DM320_REG(0x05A0)
#define IO_GIO_NCHAT DM320_REG(0x05A2)
#define IO_GIO_FSEL0 DM320_REG(0x05A4)
#define IO_GIO_FSEL1 DM320_REG(0x05A6)
#define IO_GIO_FSEL2 DM320_REG(0x05A8)
#define IO_GIO_FSEL3 DM320_REG(0x05AA)
#define IO_GIO_FSEL4 DM320_REG(0x05AC)
#define IO_GIO_CARD_SET DM320_REG(0x05AE)
#define IO_GIO_CARD_ST DM320_REG(0x05B0)
/* DSP Controller */
#define IO_DSPC_HPIB_CONTROL 0x0600
#define IO_DSPC_HPIB_STATUS 0x0602
/* OSD Controller */
#define IO_OSD_MODE 0x0680
#define IO_OSD_VIDWINMD 0x0682
#define IO_OSD_OSDWINMD0 0x0684
#define IO_OSD_OSDWINMD1 0x0686
#define IO_OSD_ATRMD 0x0688
#define IO_OSD_RECTCUR 0x0688
#define IO_OSD_RESERVED 0x068A
#define IO_OSD_VIDWIN0OFST 0x068C
#define IO_OSD_VIDWIN1OFST 0x068E
#define IO_OSD_OSDWIN0OFST 0x0690
#define IO_OSD_OSDWIN1OFST 0x0692
#define IO_OSD_VIDWINADH 0x0694
#define IO_OSD_VIDWIN0ADL 0x0696
#define IO_OSD_VIDWIN1ADL 0x0698
#define IO_OSD_OSDWINADH 0x069A
#define IO_OSD_OSDWIN0ADL 0x069C
#define IO_OSD_OSDWIN1ADL 0x069E
#define IO_OSD_BASEPX 0x06A0
#define IO_OSD_BASEPY 0x06A2
#define IO_OSD_VIDWIN0XP 0x06A4
#define IO_OSD_VIDWIN0YP 0x06A6
#define IO_OSD_VIDWIN0XL 0x06A8
#define IO_OSD_VIDWIN0YL 0x06AA
#define IO_OSD_VIDWIN1XP 0x06AC
#define IO_OSD_VIDWIN1YP 0x06AE
#define IO_OSD_VIDWIN1XL 0x06B0
#define IO_OSD_VIDWIN1YL 0x06B2
#define IO_OSD_OSDWIN0XP 0x06B4
#define IO_OSD_OSDWIN0YP 0x06B6
#define IO_OSD_OSDWIN0XL 0x06B8
#define IO_OSD_OSDWIN0YL 0x06BA
#define IO_OSD_OSDWIN1XP 0x06BC
#define IO_OSD_OSDWIN1YP 0x06BE
#define IO_OSD_OSDWIN1XL 0x06C0
#define IO_OSD_OSDWIN1YL 0x06C2
#define IO_OSD_CURXP 0x06C4
#define IO_OSD_CURYP 0x06C6
#define IO_OSD_CURXL 0x06C8
#define IO_OSD_CURYL 0x06CA
#define IO_OSD_W0BMP01 0x06D0
#define IO_OSD_W0BMP23 0x06D2
#define IO_OSD_W0BMP45 0x06D4
#define IO_OSD_W0BMP67 0x06D6
#define IO_OSD_W0BMP89 0x06D8
#define IO_OSD_W0BMPAB 0x06DA
#define IO_OSD_W0BMPCD 0x06DC
#define IO_OSD_W0BMPEF 0x06DE
#define IO_OSD_W1BMP01 0x06E0
#define IO_OSD_W1BMP23 0x06E2
#define IO_OSD_W1BMP45 0x06E4
#define IO_OSD_W1BMP67 0x06E6
#define IO_OSD_W1BMP89 0x06E8
#define IO_OSD_W1BMPAB 0x06EA
#define IO_OSD_W1BMPCD 0x06EC
#define IO_OSD_W1BMPEF 0x06EE
#define IO_OSD_MISCCTL 0x06F4
#define IO_OSD_CLUTRAMYCB 0x06F6
#define IO_OSD_CLUTRAMCR 0x06F8
#define IO_OSD_PPWIN0ADH 0x06FC
#define IO_OSD_PPWIN0ADL 0x06FE
/* CCD Controller */
#define IO_CCD_SYNCEN 0x0700
#define IO_CCD_MODESET 0x0702
#define IO_CCD_HDWIDTH 0x0704
#define IO_CCD_VDWIDTH 0x0706
#define IO_CCD_PPLN 0x0708
#define IO_CCD_LPFR 0x070A
#define IO_CCD_SPH 0x070C
#define IO_CCD_NPH 0x070E
#define IO_CCD_SLV0 0x0710
#define IO_CCD_SLV1 0x0712
#define IO_CCD_NLV 0x0714
#define IO_CCD_CULH 0x0716
#define IO_CCD_CULV 0x0718
#define IO_CCD_HSIZE 0x071A
#define IO_CCD_SDOFST 0x071C
#define IO_CCD_STADRH 0x071E
#define IO_CCD_STADRL 0x0720
#define IO_CCD_CLAMP 0x0722
#define IO_CCD_DCSUB 0x0724
#define IO_CCD_COLPTN 0x0726
#define IO_CCD_BLKCMP0 0x0728
#define IO_CCD_BLKCMP1 0x072A
#define IO_CCD_MEDFILT 0x072C
#define IO_CCD_RYEGAN 0x072E /* this is kept on the odd chance that some code is using the misspelled reg */
#define IO_CCD_RYEGAIN 0x072E
#define IO_CCD_GRCYGAIN 0x0730
#define IO_CCD_GBGGAIN 0x0732
#define IO_CCD_BMGGAIN 0x0734
#define IO_CCD_OFFSET 0x0736
#define IO_CCD_OUTCLP 0x0738
#define IO_CCD_VDINT0 0x073A
#define IO_CCD_VDINT1 0x073C
#define IO_CCD_RSV0 0x073E
#define IO_CCD_GAMMAWD 0x0740
#define IO_CCD_REC656IF 0x0742
#define IO_CCD_CCDFG 0x0744
#define IO_CCD_FMTCFG 0x0746
#define IO_CCD_FMTSPH 0x0748
#define IO_CCD_FMTLNH 0x074A
#define IO_CCD_FMTSLV 0x074C
#define IO_CCD_FMTSNV 0x074E
#define IO_CCD_FMTOFST 0x0750
#define IO_CCD_FMTRLEN 0x0752
#define IO_CCD_FMTHCNT 0x0754
#define IO_CCD_FMTPTNA 0x0756
#define IO_CCD_FMTPTNB 0x0758
/* NTSC/PAL Encoder */
#define IO_VID_ENC_VMOD 0x0800
#define IO_VID_ENC_VDCTL 0x0802
#define IO_VID_ENC_VDPRO 0x0804
#define IO_VID_ENC_SYNCCTL 0x0806
#define IO_VID_ENC_HSPLS 0x0808
#define IO_VID_ENC_VSPLS 0x080A
#define IO_VID_ENC_HINT 0x080C
#define IO_VID_ENC_HSTART 0x080E
#define IO_VID_ENC_HVALID 0x0810
#define IO_VID_ENC_VINT 0x0812
#define IO_VID_ENC_VSTART 0x0814
#define IO_VID_ENC_VVALID 0x0816
#define IO_VID_ENC_HSDLY 0x0818
#define IO_VID_ENC_VSDLY 0x081A
#define IO_VID_ENC_YCCTL 0x081C
#define IO_VID_ENC_RGBCTL 0x081E
#define IO_VID_ENC_RGBCLP 0x0820
#define IO_VID_ENC_LNECTL 0x0822
#define IO_VID_ENC_CULLLNE 0x0824
#define IO_VID_ENC_LCDOUT 0x0826
#define IO_VID_ENC_BRTS 0x0828
#define IO_VID_ENC_BRTW 0x082A
#define IO_VID_ENC_ACCTL 0x082C
#define IO_VID_ENC_PWMP 0x082E
#define IO_VID_ENC_PWMW 0x0830
#define IO_VID_ENC_DCLKCTL 0x0832
#define IO_VID_ENC_DCLKPTN0 0x0834
#define IO_VID_ENC_DCLKPTN1 0x0836
#define IO_VID_ENC_DCLKPTN2 0x0838
#define IO_VID_ENC_DCLKPTN3 0x083A
#define IO_VID_ENC_DCLKPTN0A 0x083C
#define IO_VID_ENC_DCLKPTN1A 0x083E
#define IO_VID_ENC_DCLKPTN2A 0x0840
#define IO_VID_ENC_DCLKPTN3A 0x0842
#define IO_VID_ENC_DCLKHS 0x0844
#define IO_VID_ENC_DCLKHSA 0x0846
#define IO_VID_ENC_DCLKHR 0x0848
#define IO_VID_ENC_DCLKVS 0x084A
#define IO_VID_ENC_DCLKVR 0x084C
#define IO_VID_ENC_CAPCTL 0x084E
#define IO_VID_ENC_CAPDO 0x0850
#define IO_VID_ENC_CAPDE 0x0852
#define IO_VID_ENC_ATR0 0x0854
/* Clock Controller */
#define IO_CLK_PLLA DM320_REG(0x0880)
#define IO_CLK_PLLB DM320_REG(0x0882)
#define IO_CLK_SEL0 DM320_REG(0x0884)
#define IO_CLK_SEL1 DM320_REG(0x0886)
#define IO_CLK_SEL2 DM320_REG(0x0888)
#define IO_CLK_DIV0 DM320_REG(0x088A)
#define IO_CLK_DIV1 DM320_REG(0x088C)
#define IO_CLK_DIV2 DM320_REG(0x088E)
#define IO_CLK_DIV3 DM320_REG(0x0890)
#define IO_CLK_DIV4 DM320_REG(0x0892)
#define IO_CLK_BYP DM320_REG(0x0894)
#define IO_CLK_INV DM320_REG(0x0896)
#define IO_CLK_MOD0 DM320_REG(0x0898)
#define IO_CLK_MOD1 DM320_REG(0x089A)
#define IO_CLK_MOD2 DM320_REG(0x089C)
#define IO_CLK_LPCTL0 DM320_REG(0x089E)
#define IO_CLK_LPCTL1 DM320_REG(0x08A0)
#define IO_CLK_OSEL DM320_REG(0x08A2)
#define IO_CLK_00DIV DM320_REG(0x08A4)
#define IO_CLK_O1DIV DM320_REG(0x08A6)
#define IO_CLK_02DIV DM320_REG(0x08A8)
#define IO_CLK_PWM0C DM320_REG(0x08AA)
#define IO_CLK_PWM0H DM320_REG(0x08AC)
#define IO_CLK_PWM1C DM320_REG(0x08AE)
#define IO_CLK_PWM1H DM320_REG(0x08B0)
/* Bus Controller */
#define IO_BUSC_ECR 0x0900
#define IO_BUSC_EBYTER 0x0902
#define IO_BUSC_EBITR 0x0904
#define IO_BUSC_REVR 0x0906
/* SDRAM Controller */
#define IO_SDRAM_SDBUFD0L 0x0980
#define IO_SDRAM_SDBUFD0H 0x0982
#define IO_SDRAM_SDBUFD1L 0x0984
#define IO_SDRAM_SDBUFD1H 0x0986
#define IO_SDRAM_SDBUFD2L 0x0988
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/* Preivew Engine */
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/* Reserved 0x0C00 - 0x0CCFF */
/* Memory Stick Controller : */
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/* ATM : WBB Need to find these Register values */
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/* I2C */
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/* Taken from linux/include/asm-arm/arch-itdm320/irqs.h
*
* Copyright (C) 1999 ARM Limited
* Copyright (C) 2004 Ingenient Technologies
*/
/*
* Interrupt numbers
*/
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/* Embedded Debugging Interrupts */
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/* Taken from linux/include/asm-arm/arch-integrator/timex.h
*
* Copyright (C) 1999 ARM Limited
*/
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